面試經驗
捷揚光電股份有限公司 FPGA設計
- 公司:
- 面試地區:新竹縣
- 應徵職稱:
- 面試時間:2023 年 9 月
- 面試結果:未錄取
- 整體面試滿意度:
2023 年 11 月
面試過程
第一次面試:會做相關verilog的專業測驗,部門主要就是在FPGA上把演算法轉換成硬體
第二次面試:
工作環境:
給其他面試者的中肯建議
如何準備面試:準備verilog通訊協定等的的考題,然後多敘述實作經驗
是否推薦此份工作:可以試試看
其他注意事項:
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